数字电路与逻辑设计 - 中国高校教材图书网
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书名： |
数字电路与逻辑设计
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| ISBN： | 9787560656946 |
条码： | |
| 作者： |
方怡冰
相关图书
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装订： | 0 |
| 印次： | 1-1 |
开本： | 16开 |
| 定价： |
￥48.00
折扣价：￥45.60
折扣：0.95
节省了2.4元
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字数： |
461千字
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| 出版社： |
西安电子科技大学出版社 |
页数： |
351页
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| 发行编号： | |
每包册数： |
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| 出版日期： |
2020-11-05 |
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| 内容简介： |
本书是基于OBE教育理念，按照电子信息类专业培养目标，采用反向设计的方法而编写的。本书详细介绍了数字逻辑电路的基础理论和分析、设计方法，并把数字电路的VHDL语言描述结合其中，详细介绍了数字电路系统的设计与仿真方法。此外，书中提供了大量采用Proteus和Quartus软件进行设计的实验项目和课程设计项目，以提高学生的应用能力。
本书可以作为高等学校电子信息类专业教材，也可以供数字电路设计人员参考。
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| 作者简介： |
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| 章节目录： |
第1章 数制与编码 1
1.1 进位计数制 2
1.1.1 基数和权 2
1.1.2 2n进制数之间的转换 2
1.1.3 十进制数和二进制数的转换 3
1.2 二-十进制编码 4
1.2.1 几种二-十进制编码 4
1.2.2 二-十进制编码的加法 6
1.2.3 加法电路的VHDL描述 8
1.3 格雷码 12
习题 15
第2章 逻辑代数基础 16
2.1 基本概念 16
2.1.1 逻辑变量和逻辑函数 16
2.1.2 基本逻辑运算 16
2.1.3 导出逻辑运算 18
2.1.4 逻辑函数的表示方法 20
2.2 逻辑代数的定理和规则 23
2.2.1 逻辑代数的基本定律 23
2.2.2 常用公式 23
2.2.3 展开定理 24
2.2.4 逻辑代数的三个规则 25
2.3 逻辑函数的标准表达式 25
2.3.1 标准与或式 26
2.3.2 标准或与式 27
2.3.3 不完全确定的逻辑函数 28
2.4 数字逻辑电路设计方法 30
2.4.1 逻辑电路的设计 30
2.4.2 两个2421BCD码相加和的调整电路设计 31
习题 35
第3章 集成逻辑门电路 39
3.1 MOS晶体管 39
3.1.1 MOS晶体管的分类 39
3.1.2 MOS管的三个工作区 40
3.1.3 MOS管的开关时间 40
3.2 CMOS反相器 41
3.2.1 CMOS反相器的结构和工作原理 41
3.2.2 CMOS反相器的电压传输特性 42
3.2.3 CMOS反相器功耗 44
3.2.4 CMOS反相器的开关时间 44
3.3 CMOS其他逻辑门电路 45
3.3.1 CMOS与非门 45
3.3.2 CMOS或非门 46
3.3.3 门的输入端数的扩展 47
3.3.4 缓冲门、与门及或门 47
3.3.5 CMOS与或非门和异或门 48
3.4 CMOS集成电路的输出结构 49
3.4.1 推挽输出 49
3.4.2 三态输出 49
3.4.3 漏极开路输出 50
3.5 CMOS电路使用中应该注意的问题 51
3.6 TTL逻辑门电路简介 53
3.7 组合逻辑电路的竞争与冒险 54
3.7.1 冒险的分类 55
3.7.2 冒险的检查及消除 56
习题 58
第4章 中规模组合电路及VHDL描述设计 61
4.1 常见组合电路结构 61
4.2 编码器 62
4.2.1 普通编码器的VHDL描述 62
4.2.2 2421码编码器的VHDL描述 65
4.2.3 优先编码器74HC148 66
4.2.4 优先权编码器的VHDL描述 68
4.3 译码器 69
4.3.1 普通译码器的VHDL描述 69
4.3.2 2421码译码器的VHDL描述 70
4.3.3 中规模译码器74HC139、74HC138、74HC154 71
4.3.4 用VHDL描述中规模译码器74HC138
74
4.3.5 显示译码器74LS47、74LS48 75
4.3.6 用VHDL描述显示译码器 77
4.4 加法器 78
4.4.1 中规模全加器74LS83、74HC283
78
4.4.2 利用中规模全加器做全减器 79
4.4.3 利用VHDL描述加/减法器 81
4.4.4 中规模电路设计 83
4.5 数据选择器 85
4.5.1 用VHDL描述数据选择器 86
4.5.2 利用中规模数据选择器设计电路 87
4.6 数值比较器 92
4.7 综合设计 94
4.7.1 用中规模电路及门电路设计 96
4.7.2 用VHDL设计 97
4.7.3 利用4位V5421FULL加法电路扩展设计8位加法电路 108
习题 109
第5章 集成触发器 115
5.1 触发器的基本特性及其记忆作用 116
5.2 电位型触发器 117
5.2.1 基本RS触发器 117
5.2.2 带使能端的RS触发器 123
5.2.3 D触发器 123
5.2.4 锁存器 124
5.3 时钟控制的集成触发器 125
5.3.1 主从触发器 125
5.3.2 T触发器 129
5.3.3 边沿触发器 129
5.4 集成触发器的时间参数 133
5.4.1 建立时间和保持时间 133
5.4.2 时钟信号的时间参数 134
习题 134
第6章 时序逻辑电路的分析、设计和描述 139
6.1 时序电路基础 139
6.1.1 同步时序电路的分类和描述 139
6.1.2 常用时序电路 140
6.2 小规模计数器的分析、设计及VHDL描述 142
6.2.1 小规模计数器的分析 142
6.2.2 小规模计数器的设计 146
6.3 小规模一般时序电路的设计及VHDL描述 152
6.3.1 投币机的设计举例 152
6.3.2 空调温度调节电路设计举例 158
6.4 中规模集成计数器及应用设计 162
6.4.1 可预置十进制可逆计数器74LS192 163
6.4.2 利用74LS192设计万年历 167
6.4.3 四位二进制加1计数器74LS169 172
6.5 小规模移位寄存器及VHDL描述 176
6.5.1 移位寄存器的构成 176
6.5.2 环形、扭环形计数器 178
6.5.3 序列信号发生器 181
6.6 中规模移位寄存器及应用设计 190
6.6.1 通用移位寄存器74LS194及序列信号发生器设计 191
6.6.2 JK输入的移位寄存器74LS195及M序列的缩短设计 192
6.6.3 8位移位寄存器74LS164及串—并转换电路设计 193
6.6.4 8位移位寄存器74LS166及并—串转换电路设计 197
6.6.5 8位并—串—并转换电路设计 199
6.6.6 利用中规模芯片设计序列信号发生器电路 200
6.7 序列信号的产生与接收检测电路的设计 203
6.7.1 序列信号发生器电路的VHDL描述 203
6.7.2 序列信号接收检测电路设计 204
6.7.3 组成完整的序列信号产生和接收检测电路 208
6.8 红外传输系统的设计与仿真 209
6.8.1 空调机温度信号、基带信号产生及调制信号产生电路 211
6.8.2 空调机温度调节总电路及接收解码 214
6.8.3 仿真结果分析 216
习题 218
第7章 实验与课程设计 226
7.1 Proteus快速入门 226
7.2 FPGA开发板简介 230
7.3 基于FPGA开发板的Quartus使用教程 239
7.4 实验项目 256
7.4.1 组合逻辑电路实验(一) 256
7.4.2 组合逻辑电路实验(二) 258
7.4.3 组合逻辑电路实验(三) 260
7.4.4 组合逻辑电路实验(四) 263
7.4.5 组合逻辑电路实验(五) 265
7.4.6 组合逻辑电路实验(六) 267
7.4.7 组合逻辑电路实验(七) 271
7.4.8 时序逻辑电路实验(一) 274
7.4.9 时序逻辑电路实验(二) 276
7.4.10 时序逻辑电路实验(三) 277
7.4.11 时序逻辑电路实验(四) 280
7.4.12 时序逻辑电路实验(五) 282
7.4.13 时序逻辑电路实验(六) 286
7.5 系统综合设计项目 289
7.5.1 数字万年历 289
7.5.2 基于红外通信的空调温度控制器 297
7.5.3 交通信号灯控制器 301
7.5.4 红外遥控数字密码锁 302
参考文献 304
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| 书 评： |
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| 其 它： |
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